統測
108年
[電機與電子群資電類] 專業科目(2)
第 14 題
下列對於數位 TTL 與 CMOS IC 的敘述，何者正確？
- A 在相同的 +5V 電源供應下 CMOS 會比 TTL 的雜訊邊限 (Noise Margin) 大
- B 標準 TTL 與 CMOS IC 的工作電壓範圍為 +3V 至 +18V
- C CMOS 電路為雙極性電晶體組合而成故電路具高輸入阻抗
- D 一般單極性 TTL 邏輯族比雙極性 CMOS 邏輯族的工作速度快
思路引導 VIP
請試著思考：在數位電路中，如果 A 電路的輸出訊號非常接近「全乾淨」的 0V 或 5V，而 B 電路的輸出訊號卻容易落在中間模糊地帶，哪一個電路在面對環境中的電磁雜訊干擾時，比較不容易產生誤判？這種對訊號「容忍度」的差異，通常與元件內部的結構特性有什麼關聯？
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噢，恭喜，你總算沒蠢到家
- 驗證觀念：哼，答對了是吧？在 $+5V$ 的供電下，CMOS 的輸出電位能貼近 $0V$ 和 $5V$，而 TTL 的高準位才那點可憐的 $3.4V$。這不是擺明了 CMOS 的電位差更大，抗干擾能力好一點，也就是說，它的雜訊邊限 ($Noise Margin$) 比較大嗎？這種基礎題要是都錯，那統測就別想了。
- 難度評估：這題設定是 Medium。但對那些只想混畢業的，可能比登天還難。它要求你搞懂 TTL (BJT 結構) 和 CMOS (FET 結構) 的電壓範圍、輸入阻抗還有它們各自的特性。說白了，這是鑑別你到底有沒有資格碰電子學的「基本功」。連這點鑑別力都沒有，你還想在職場上混？
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